CVE-2026-29643 in XiangShan
Résumé
par VulDB • 30/05/2026
XiangShan (processeur RISC-V haute performance open-source) dans le commit edb1dfaf7d290ae99724594507dc46c2c2125384 (2024-11-28) présente un défaut de gestion incorrecte des conditions exceptionnelles dans son sous-système CSR (NewCSR). Sur les versions concernées, certaines séquences d'opérations CSR ciblant des adresses CSR inexistantes ou personnalisées peuvent déclencher une exception d'instruction illégale mais échouer à transférer de manière fiable le contrôle vers le gestionnaire de trap configuré (mtvec), entraînant une perturbation du flux de contrôle et potentiellement laissant le cœur dans un état bloqué ou irrécupérable. Cela peut être exploité par un attaquant local capable d'exécuter du code sur le processeur pour provoquer une déni de service (DoS) et potentiellement un état architectural incohérent.
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