CVE-2026-19571 in Zephyr
Zusammenfassung
von VulDB • 09.10.2026
Der ITE IT8xxx2 SHI Host-Befehl-Backend (subsys/mgmt/ec_host_cmd/backends/ec_host_cmd_backend_shi_ite.c) kopierte den 8-Byte langen Header der Host-Befehlsanfrage direkt aus dem SPI Rx-FIFO in den gemeinsamen Empfangspuffer data->in_msg und überprüfte erst danach die Protokollversion sowie die abgeleitete Paketlänge. Der Interrupt-Handler akzeptierte zudem eine Chip-Select-Aktivierung (Assertion) und einen RVLI-Interrupt (Rx-valid-length) in jedem Treiberzustand außer SHI_STATE_DISABLED, sodass ein neuer Header analysiert werden konnte, während der Host-Befehlsthread noch die vorherige Anfrage aus genau demselben Puffer verarbeitete.
Der Host-Prozessor ist der SPI-Controller und steuert sowohl den Chip Select als auch die Taktleitung. Nach dem Senden einer wohlgeformten Anfrage kann er den Chip Select sofort deaktivieren (de-assert), was den Treiber in den Ready-Zustand zurückversetzt und den FIFO wieder aktiviert, sowie eine zweite Transaktion starten, die einen Header mit data_len = 0xFFFF enthält. Diese acht Bytes werden in in_msg geschrieben, bevor die übermäßige Länge abgelehnt wird; sie landen somit in einem Puffer, dessen Inhalt von verify_rx() in subsys/mgmt/ec_host_cmd/ec_host_cmd_handler.c bereits validiert wurde. Wenn dies im Zeitfenster vor der Ausführung durch den Host-Befehlsthread erfolgt (args.input_buf_size = rx_header->data_len), übergibt das Framework dem registrierten Befehlshandler eine Eingabelänge von 65.535 Bytes über einen 256-Byte-Puffer.
Das Ergebnis ist ein Out-of-Bounds-Lesezugriff auf bis zu etwa 64 KiB jenseits des Anfragepuffers: Befehlshandler, die input_buf_size Bytes kopieren oder echoen, geben benachbarten Embedded-Controller-Speicher an den Host zurück oder überlaufen den Antwortpuffer; ein Lesezugriff hinter dem Ende von SRAM führt zu einem Controller-Fault. Derselbe Race Condition ermöglicht auch das Vertauschen von cmd_id und cmd_ver nach der Prüfsummenüberprüfung und nach der Handler-Suche. Die Ausnutzung (Exploitation) erfordert die Fähigkeit, den inter-prozessorischen SHI-Bus anzusteuern (ein kompromittiertes Host-Betriebssystem oder physischer Zugriff auf die SPI-Leitungen) sowie einen Timing-Race zu gewinnen, was der SPI-Controller unbegrenzt wiederholen kann.
Die Korrektur analysiert den Header in eine lokale Struktur ec_host_cmd_request_header und kopiert ihn erst nach dem Begrenzen der Länge durch sizeof(data->in_msg) in in_msg; zudem werden Chip-Select- und RVLI-Interrupts außerhalb von SHI_STATE_READY_TO_RECV/SHI_STATE_RECEIVING ignoriert. Es verbleibt ein residueller, begrenzter Race Condition: Ein End-of-Transaction-Interrupt setzt den Zustand weiterhin auf Ready zurück, während der Host-Befehlsthread den Puffer besitzt; daher kann eine gültige zweite Anfrage immer noch die Inhalte der laufenden Anfrage überschreiben, im Gegensatz zum NPCX-Backend, das in SHI_STATE_CNL_RESP_NOT_RDY parkt, solange der Puffer verwendet wird.
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